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典型的高速背板互连系统高速背板互连测试概述数字通信系统在较低的信号速率时，这些互连的电长度很短，驱动器和接收机一般是导致信号完整性问题的主要因素。但随着时钟速率、总线速率及链路速率突破每秒千兆大关，物理层特性测试正变得日益关键。时域分析一般用来描述这些物理层结构的特征，但通常情况下，设计人员在测试时往往只考虑器件工作在其被期望的工作模式上时的情况。为了获得一个完整的时域信息，必须要测试反射和传输（TDR和TDT）中的阶跃和脉冲相应。如果将“L”和“E”接反了，流过缘体内及表面的漏电流经外壳汇集到地，由地经“L”流进测量线圈，使“G”失去作用而给测量带来很大误差。另外，因为“E”端内部引线同外壳的缘程度比“L”端与外壳的缘程度要低，当兆欧表放在地上使用时，采用正确接线方式时，“E”端对仪表外壳和外壳对地的缘电阻，相当于短路，不会造成误差，而当“L”与“E”接反时，“E”对地的缘电阻同被测缘电阻并联，而使测量结果偏小，给测量带来较大误差。
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